A Digital Design Flow for Secure Integrated Circuits

机译：安全集成电路的数字设计流程

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Kris Tiri; Ingrid Verbauwhede;
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年度 2006
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1. A digital design flow for secure integrated circuits [J] . Tiri K., Verbauwhede I. IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems . 2006,第7期

机译：安全集成电路的数字设计流程
2. α -power law based MOSFET model for characterization of ultra deep submicron digital integrated circuit design]]> [J] . Shruti Kalra, AB Bhattacharyya AEU: Archiv fur Elektronik und Ubertragungstechnik: Electronic and Communication . 2018,第期

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8. Design and Development of a Digital Subsystem Employing n and p-Channel MOS Fet's in Complementary Circuits in an Integrated Circuit Array Final Report, 1 May 1967 - 30 Apr. 1968 [R] . Keller, K. R., Yung, A. 1968

机译：采用n和p沟道mOs Fet的数字子系统的设计和开发在集成电路阵列的互补电路中最终报告，1967年5月1日 - 1968年4月30日

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